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[차세대] [IDEC] RTL-to-GDSII 실무를 위한 디지털집적회로 이론 및 설계
작성자 : 공가현 작성일 : 2024-05-23 09:32:40    조회수 : 6766
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안녕하세요. 차세대 반도체 혁신융합대학 사업단입니다.

반도체설계교육센터(IDEC)에서 진행되는 <<full custom="" ic=""></full>RTL-to-GDSII 실무를 위한 디지털 집적회로 이론 및 설계> 강좌를 아래와 같이 안내드리오니 참고하여 신청 부탁드립니다.

RTL-to-GDSII 실무를 위한 디지털 집적회로 이론 및 설계


1. 교육 일시 : 2024년 06월 18일(화) ~ 20일(목) 10시 00분 ~ 18시 00분
2. 장소 : 경북대학교 IT대학2호관 206호
3. 강사 : 송대건 교수(경북대)

4. 신청 기간 (☞바로가기)
    - 재직자 우선 신청 : 2024년 05월 22일(수) 00시 00분 ~  05월 28일(화) 23시59분
    - 전체 신청 : 2024년 05월 29일(수) 00시 00분 ~ 2024년 06월 13일(목) 23시 59분
5. 강의 개요
      본 강좌는 반도체 (IC) 설계의 여러 단계 중 '물리적 설계 (physical design)'를 하는 방법을 다룹니다. 물리적 설계란,
      디지털 IC를 설계하는 기본적인 구성요소인 논리 게이트 (standard cell), 및 메모리 (SRAM)를 직접 실리콘 칩에 배치
      하고 연결하는 매우 중요한 과정입니다. 본 강좌에서는 논리적 설계에서 HDL로 디지털 회로의 코딩이 완료되면 (RTL),
      이를 바탕으로 논리 게이트로 합성 (synthesis) 후 직접 배치 및 연결 (place & route) 하여 최종 분석 (sign-off) 하는
      일련의 과정을 배우게 됩니다. 본 수업은 Synopsys 사의 tool들을 이용하여 이 모든 과정들이 어떻게 이루어지는지를
      실제 사용 예를 통해 이해하도록 하며, RTL에서 최종 물리설계의 결과물인 GDSII를 (RTL-to-GDSII) 추출하는 과정을
      이해하는 것을 통해 반도체 산업 현장에서 사용되는 기술을 배우는 것을 그 목표로 합니다.
     ☞ 1개의 교육에 대해 전일 결석시, 이후 3개월간 수강신청이 자동차단됩니다. 신청 후 수강이 어려우신 분들은
     수강신청 기간내 에 홈페이지에서 수강취소 바랍니다.


딤당 : 김지영 선생님 (053-950-6858, idec@knu.ac.kr)
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